NameBellido Díaz, Manuel Jesús
DepartmentTecnología Electrónica
Knowledge areaTecnología Electrónica
Professional categoryCatedrático de Universidad
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IRIS: An embedded secure boot for IoT devices

Cano Quiveu, Germán; Cano Quiveu, Germán; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián (Elsevier, 2023)
This study proposes a hardware secure boot solution, an instant retrieval information system (IRIS) that is suitable for ...
PhD Thesis
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LILA (Low-level IoT Ligtweigth Applications): aplicaciones hardware para dispositivos IoT

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Cano Quiveu, Germán; Cano Quiveu, Germán (2022)
Esta tesis se enmarca dentro del Proyecto de Investigación TIN2017-89951-P: BootTimeIoT: Sistemas de inicio avanzados y ...
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An Integrated Digital System Design Framework With On-Chip Functional Verification and Performance Evaluation

Cano Quiveu, Germán; Cano Quiveu, Germán; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Guerrero Martos, David; Guerrero Martos, David; Viejo Cortés, Julián; Viejo Cortés, Julián; Juan Chico, Jorge; Juan Chico, Jorge (IEEE Computer Society, 2021)
This paper introduces a design and on-chip verification framework for IPCores in FPGA platforms. The methodology of the ...
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Embedded LUKS (E-LUKS): A Hardware Solution to IoT Security

Cano Quiveu, Germán; Cano Quiveu, Germán; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (MDPI, 2021)
The Internet of Things (IoT) security is one of the most important issues developers have to face. Data tampering must be ...
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Address-encoded byte order

Guerrero Martos, David; Guerrero Martos, David; Cano Quiveu, Germán; Cano Quiveu, Germán; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Viejo Cortés, Julián; Viejo Cortés, Julián; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Elsevier, 2020)
Unaligned accesses are forbidden in many high-performance architectures. In most of these architectures, the least significant ...
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Using the complement of the cosine to compute trigonometric functions

Guerrero Martos, David; Guerrero Martos, David; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Springer, 2020)
The computation of the sine and cosine functions is required in devices ranging from application-specific signal processors ...
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High-Performance Time Server Core for FPGA System-on-Chip

Viejo Cortés, Julián; Viejo Cortés, Julián; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Cano Quiveu, Germán; Cano Quiveu, Germán (MDPI, 2019)
This paper presents the complete design and implementation of a low-cost, low-footprint, network time protocol server core ...
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Minimalistic SDHC-SPI hardware reader module for boot loader applications

Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Guerrero Martos, David; Guerrero Martos, David (Elsevier, 2017)
This paper introduces a low-footprint full hardware boot loading solution for FPGA-based Programmable Systems on Chip. The ...
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Metodología PBL en modo colaborativo aplicada al diseño de un SoC

Barrero, Federico; Barrero, Federico; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Jiménez Fernández, Carlos Jesús; Jiménez Fernández, Carlos Jesús; Toral, S. L.; Toral, S. L.; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Universidad de Sevilla, 2016)
Dado el carácter principalmente práctico en las asignaturas de los másteres universitarios la metodología PBL es ampliamente ...
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Building a basic membrane computer

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Viejo Cortés, Julián; Viejo Cortés, Julián; Quirós Carmona, Juan; Quirós Carmona, Juan; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Fénix, 2016)
In this work, we present the building of two well-known membrane com- puters (squares generator and divisor test). Although ...
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Fast Hardware Implementations of Static P Systems

Quirós Carmona, Juan; Quirós Carmona, Juan; Verlan, Sergey; Verlan, Sergey; Viejo Cortés, Julián; Viejo Cortés, Julián; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (2016)
In this article we present a simulator of non-deterministic static P systems using Field Programmable Gate Array (FPGA) ...
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evercodeML: a formal language for SoC integration

Villar de Ossorno, José Ignacio; Villar de Ossorno, José Ignacio; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Viejo Cortés, Julián; Viejo Cortés, Julián (IEEE Computer Society, 2015)
Complex SoC design devote a great part of the developing time to module integration tasks. The necessity of automating ...
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NanoFS: a hardware-oriented file system

Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Viejo Cortés, Julián; Viejo Cortés, Julián; Guerrero Martos, David; Guerrero Martos, David (IEEE Computer Society, 2013)
NanoFS is a novel file system for embedded systems and storage-class memories (like flash) and is specially designed to be ...
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Open Development Platform for Embedded Systems

Maad, Soha; Maad, Soha; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Muñoz Rivera, Alejandro; Muñoz Rivera, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Guerrero Martos, David; Guerrero Martos, David; Millán Calderón, Alejandro; Millán Calderón, Alejandro (IntechOpen, 2012)
PhD Thesis
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Técnicas de Implementación de Circuitos Integrados Digitales CMOS de Alta Velocidad de Operación y Bajo Consumo de Potencia

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David (2012)
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Network Time Synchronization: A Full Hardware Approach

Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (Springer, 2012)
Complex digital systems are typically built on top of several abstraction levels: digital, RTL, computer, operating system ...
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Fast-Convergence Microsecond-Accurate Clock Discipline Algorithm for Hardware Implementation

Viejo Cortés, Julián; Viejo Cortés, Julián; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino (IEEE Computer Society, 2011)
Discrete microprocessor-based equipment is a typical synchronization system on the market which implements the most ...
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Python as a hardware description language: A case study

Villar de Ossorno, José Ignacio; Villar de Ossorno, José Ignacio; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Viejo Cortés, Julián; Viejo Cortés, Julián; Guerrero Martos, David; Guerrero Martos, David; Decaluwe, J.; Decaluwe, J. (IEEE Computer Society, 2011)
Many people may see the development of software and hardware like different disciplines. However, there are great similarities ...
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Design and implementation of a suitable core for on-chip long-term verification

Viejo Cortés, Julián; Viejo Cortés, Julián; Villar de Ossorno, José Ignacio; Villar de Ossorno, José Ignacio; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (IEEE Computer Society, 2010)
Traditional on-chip and off-chip logic analyzers present important shortcomings when used for the long-term verification ...
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Delay and power consumption of static bulk-CMOS gates using independent bodies

Guerrero Martos, David; Guerrero Martos, David; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (IEEE Computer Society, 2009)
Digital designs implemented using SOI processes employ separated bodies for each transistor. This approach is not usually ...
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Efficient techniques and methodologies for embedded system design usign free hardware and open standards

Villar de Ossorno, José Ignacio; Villar de Ossorno, José Ignacio; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (IEEE Computer Society, 2009)
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La primera experiencia en el diseño de sistemas digitales sobre FPGAs

Viejo Cortés, Julián; Viejo Cortés, Julián; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David; Muñoz Rivera, Alejandro; Muñoz Rivera, Alejandro (Universidad de Zaragoza, 2008)
Se presenta una práctica de introducción al diseño de sistemas digitales sobre FPGAs. El objetivo es que se pueda realizar ...
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La primera experiencia en el diseño de sistemas digitales sobre FPGAs

Viejo Cortés, Julián; Viejo Cortés, Julián; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David; Muñoz, A.; Muñoz, A. (Universidad Politécnica de Madrid, 2008)
Se presenta una práctica de introducción al diseño de sistemas digitales sobre FPGAs. El objetivo es que se pueda realizar ...
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Digital Data Processing Peripheral Design for an Embedded Application based on the Microblaze Soft Core

Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Muñoz Rivera, Alejandro; Muñoz Rivera, Alejandro (IEEE Computer Society, 2008)
In this paper we present a design of a peripheral for MicroBlaze soft core processor as part of a R+D project carried out ...
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Power Dissipation Associated to Internal Effect Transitions in Static CMOS Gates

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Guerrero Martos, David; Guerrero Martos, David; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Viejo Cortés, Julián; Viejo Cortés, Julián (Springer, 2008)
Power modeling techniques have traditionally neglected the main part of the energy consumed in the internal nodes of static ...
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Design and Implementation of a SNTP Client on FPGA

Viejo Cortés, Julián; Viejo Cortés, Julián; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Muñoz Rivera, Alejandro; Muñoz Rivera, Alejandro; Guerrero Martos, David; Guerrero Martos, David (IEEE Computer Society, 2008)
This contribution presents the design and implementation of a SNTP client module suitable for IEC 61850 environments fully ...
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Implementation of a FFT/IFFT Module on FPGA: Comparison of Methodologies

Viejo Cortés, Julián; Viejo Cortés, Julián; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Muñoz Rivera, Alejandro; Muñoz Rivera, Alejandro (IEEE Computer Society, 2008)
In this work, we have compared three different methodologies for the implementation of a FFT/IFFT module on FPGA: VHDL ...
PhD Thesis
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Técnicas de optimización para el modelado y la caracterización del comportamiento dinámico de circuitos digitales CMOS en tecnologías UDSM

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro (2008)
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Building a SoC for industrial applications based on LEON microprocessor and a GNU/Linux distribution

Muñoz, A.; Muñoz, A.; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David (IEEE Computer Society, 2008)
This paper presents the design of a complete RTU (Remote Terminal Unit) with a System-on-Chip solution based completely ...
PhD Thesis
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Simulación lógica temporal de altas prestaciones y aplicación a la estimación del consumo de potencia y corriente en circuitos integrados CMOS-VLSI

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino (2007)
El primer capítulo está dedicado a la simulación y verificación temporal de circuitos VLSI en general, así como a los ...
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Static Power Consumption in CMOS Gates Using Independent Bodies

Guerrero Martos, David; Guerrero Martos, David; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Springer, 2007)
It has been reported that the use of independent body terminals for series transistors in static bulk-CMOS gates improves ...
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Design of a FFT/IFFT module as an IP core suitable for embedded systems

Viejo Cortés, Julián; Viejo Cortés, Julián; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Muñoz Blanco, Antonio; Muñoz Blanco, Antonio (IEEE Computer Society, 2007)
In this work, we have laid the foundations that allow us to accomplish the implementation of a FFT/IFFT module as an IP ...
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Automatic logic synthesis for parallel alternating latches clocking schemes

Guerrero Martos, David; Guerrero Martos, David; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (SPIE Digital Library, 2007)
This paper proposes a VHDL coding technique that allows for the automatic synthesis of digital circuits using the so called ...
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Diseño e Implementación Óptima de Periféricos de DSP con System Generator para Microblaze

Viejo Cortés, Julián; Viejo Cortés, Julián; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David (IBERCHIP, 2006)
Con este trabajo pretendemos analizar como se lleva a cabo el diseño de periféricos de DSP utilizando uno de los nuevos ...
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A SoC Design Methodology for LEON2 on FPGA

Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Juan Chico, Jorge; Juan Chico, Jorge; Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Guerrero Martos, David; Guerrero Martos, David; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino (IBERCHIP, 2006)
SoC design methodologies show up as a natural and productive method to implement embedded and/or ubiquitous systems. The ...
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Diseño e implantación de SoPC basados en el microprocesador PicoBlaze

Viejo Cortés, Julián; Viejo Cortés, Julián; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David (Universidad Politécnica de Madrid, 2006)
Con este trabajo pretendemos realizar una aportación a la docencia de la materias que cu bren el diseño de SoPC (System ...
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Efficient Design and Implementation on FPGA of a MicroBlaze Peripheral for Processing Direct Electrical Networks Measurements

Viejo Cortés, Julián; Viejo Cortés, Julián; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David (IEEE Computer Society, 2006)
This contribution successfully accomplished the design and implementation of an advanced DSP circuit for direct measurements ...
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Desarrollo en VHDL de un filtro digital genérico basado en estructuras canónicas.

Álvarez, A.; Álvarez, A.; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Universidad Politécnica de Madrid, 2006)
Este trabajo abarca la realización de un filtro digital a bajo nivel. El diseño propuesto se basa en la utilización de un ...
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Diseño e implementación de SOPC basados en el microprocesador Picoblaze

Viejo Cortés, Julián; Viejo Cortés, Julián; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David (Universidad Politécnica de Madrid, 2006)
Con este trabajo pretendemos realizar una aportación a la docencia de la materias que cubren el diseño de SoPC (System on ...
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Automated performance evaluation of skew-tolerant clocking schemes

Guerrero Martos, David; Guerrero Martos, David; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Taylor and Francis Online, 2006)
In this paper the authors evaluate the timing and power performance of three skew-tolerant clocking schemes. These schemes ...
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Optimization techniques for dynamic behavior modeling of digital CMOS VLSI circuits in nanometric technologies

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge (IEEE Computer Society, 2005)
In the field of logic simulation, the constant advance of technology influences remarkably in the circuits dynamic behavior. ...
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Efficient Design of a FFT/IFFT-64 Module on ASIC

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (IBERCHIP, 2005)
In this work we present the VHDL implementation of a FFT/IFFT-64 module. This implementation: (a) is relatively quick and ...
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Algorithms to get the maximum operation frequency for skew-tolerant clocking schemes

Guerrero Martos, David; Guerrero Martos, David; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Society of Photo-Optical Instrumentation Engineers (SPIE), 2005)
Nowadays it is not possible to neglect the delay of interconnection lines. The die size is rising very fast, and the delay ...
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Application of Internode model to global power consumption estimation in SCMOS gates

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Springer, 2005)
In this paper, we present a model, Internode, that unifies the gate functional behavior and the dynamic one. It is based ...
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Logic-Level Fast Current Simulation for Digital CMOS Circuits

Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Viejo Cortés, Julián; Viejo Cortés, Julián (Springer, 2005)
Nowadays, verification of digital integrated circuit has been focused more and more from the timing and area field to ...
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Análisis del comportamiento de la videoconsola Atari 2600 como sistema digital real basado en microprocesador en el laboratorio de electrónica.

Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Villar, José Ignacio; Villar, José Ignacio (Universidad Politécnica de Valencia, 2004)
En este trabajo se propone una práctica de laboratorio para la asignatura Estructura de Computadores de primer curso de ...
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Seguridad en Internet: web spoofing

Nuñez, José L.; Nuñez, José L.; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge (Universidad Politécnica de Valencia, 2004)
En este trabajo se estudia la técnica Web Spoofing como método de ataque a través de Internet. Se trata de una variante ...
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ADKI: un sistema web de adquisición de datos bajo Linux

Jurado Maqueda, Pedro; Jurado Maqueda, Pedro; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Universidad Politécnica de Valencia, 2004)
Esta contribución presenta una aplicación genérica de adquisición de datos y control para sistemas simples que incorpora ...
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Modelos de adaptación de los programas formativos al espacio europeo

Fortet Roura, Pedro; Fortet Roura, Pedro; Sivianes Castillo, Francisco; Sivianes Castillo, Francisco; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (Universidad Politécnica de Valencia, 2004)
Ante el volumen de información a veces contradictoria acerca de la educación, en este artículo pretendemos presentar una ...
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Signal Sampling Based Transition Modeling for Digital Gates Characterization

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (Springer, 2004)
Current characterization methods introduce an important error in the measurement process. In this paper, we present a novel ...
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Diseño del microcontrolador 8051 con módulo ensamblador- generador de ROM en lenguaje VHDL

Franco, Ezequiel; Franco, Ezequiel; Montero, Fernando; Montero, Fernando; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Guerrero Martos, David; Guerrero Martos, David; Juan Chico, Jorge; Juan Chico, Jorge (Universidad Politécnica de Valencia, 2004)
En este trabajo se presenta el resultado de un Proyecto Fin de Carrera en el que se ha diseñado el microcontrlador 8051 ...
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Internode: Internal Node Logic Computational Model

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Guerrero Martos, David; Guerrero Martos, David; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Ostúa Arangüena, Enrique; Ostúa Arangüena, Enrique (IEEE Computer Society, 2003)
In this work, we present a computational behavioral model for logic gates called Internode (Internal Node Logic Computational ...
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Aprendizaje interdisciplinar de la electrónica y las comunicaciones

Yúfera García, Alberto; Yúfera García, Alberto; Fortet Roura, Pedro; Fortet Roura, Pedro; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Chico, J.J.; Chico, J.J.; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (Universidad de Sevilla: Instituto de Ciencias de la Educación, 2003)
En este proyecto de innovación docente se pretende profundizar en el conocimiento de la base teórica, la construcción de ...
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Computational Delay Models to Estimate the Delay of Floating Cubes in CMOS Circuits

Guerrero Martos, David; Guerrero Martos, David; Wilke, G.; Wilke, G.; Güntzel, J.L.; Güntzel, J.L.; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Millán Calderón, Alejandro; Millán Calderón, Alejandro (Springer, 2003)
The verification of the timing requirements of large VLSI circuits is generally performed by using simulation or timing ...
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Characterization of Normal Propagation Delay for Delay Degradation Model (DDM)

Millán Calderón, Alejandro; Millán Calderón, Alejandro; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Guerrero Martos, David; Guerrero Martos, David (Springer, 2002)
In previous papers we have presented a very accurate model that handles the generation and propagation of glitches, which ...
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Measurement of the Switching Activity of CMOS Digital Circuits at the Gate Level

Baena Oliva, María del Carmen; Baena Oliva, María del Carmen; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Jiménez Fernández, Carlos Jesús; Jiménez Fernández, Carlos Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Springer, 2002)
Accurate estimation of switching activity is very important in digital circuits. In this paper we present a comparison ...
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Efficient and Fast Current Curve Estimation of CMOS Digital Circuits at the Logic Level

Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Millán Calderón, Alejandro; Millán Calderón, Alejandro; Guerrero Martos, David; Guerrero Martos, David (Springer, 2002)
This contribution presents a method to obtain current estimations at the logic level. This method uses a simple current ...
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AUTODDM: AUTOmatic characterization tool for the Delay Degradation Model

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Baena Oliva, María del Carmen; Baena Oliva, María del Carmen; Valencia Barrero, Manuel; Valencia Barrero, Manuel (IEEE Computer Society, 2001)
As delay models used in logic timing simulation become more and more complex, the problem of model parameter values ...
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HALOTIS: high accuracy LOgic TIming simulator with inertial and degradation delay model

Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel; Valencia Barrero, Manuel (IEEE Computer Society, 2001)
This communication presents HALOTIS, a novel high accuracy logic timing simulation tool, that incorporates a new simulation ...
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Gate-Level Simulation of CMOS Circuits Using the IDDM Model

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel; Valencia Barrero, Manuel (IEEE Computer Society, 2001)
Timing verification of digital CMOS circuits is a key point in the design process. In this contribution we present the ...
PhD Thesis
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Degradación del retraso de propagación en puertas lógicas CMOS VLSI

Valencia Barrero, Manuel; Valencia Barrero, Manuel; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Barriga Barros, Ángel; Barriga Barros, Ángel; Juan Chico, Jorge; Juan Chico, Jorge (2000)
La evolución en la tecnología de circuitos VLSI da lugar, entre otras cosas, a un aumento en la escala de integración ...
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Inertial and Degradation Delay Model for CMOS Logic Gates

Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel; Valencia Barrero, Manuel (IEEE Computer Society, 2000)
The authors present the Inertial and Degradation Delay Model (IDDM) for CMOS digital simulation. The model combines the ...
Chapter of Book
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Degradation Delay Model Extension to CMOS Gates

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Springer, 2000)
This contribution extends the Degradation Delay Model (DDM), previously developed for CMOS inverters, to simple logic ...
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Concepción de un microprocesador: de la especificación a la realización

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Ruiz de Clavijo Vázquez, Paulino; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José (Universidad Politécnica de Madrid, 2000)
Chapter of Book
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Influence of Clocking Strategies on the Design of Low Switching-Noise Digital and Mixed-Signal VLSI Circuits

Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Jiménez, R.; Jiménez, R.; Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Springer, 2000)
This communication shows the influence of clocking schemes on the digital switching noise generation. It will be shown how ...
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Un entorno informático de ayuda a la docencia de sistemas de comunicación optoelectrónicos

Verd, J.; Verd, J.; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José (Universidad Politécnica de Madrid, 2000)
Article
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Aprendiendo a diseñar circuitos integrados digitales mediante el uso del ordenador

Parada Sanguino, Margarita; Parada Sanguino, Margarita; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Gómez González, Isabel María; Gómez González, Isabel María; Juan Chico, Jorge; Juan Chico, Jorge; Barriga Barros, Ángel; Barriga Barros, Ángel (Universidad de Sevilla, 1999)
En este trabajo se presenta una experiencia docente encaminada a mejorar la asimilación por parte de los alumnos de algunos ...
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Realización de un Sistema Digital: implementación sobre FPGA y testado en Laboratorio

Baena Oliva, María del Carmen; Baena Oliva, María del Carmen; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Parra Fernández, María del Pilar; Parra Fernández, María del Pilar; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Universidad Politécnica de Madrid, 1998)
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Delay degradation effect in submicronic CMOS inverters

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Barriga Barros, Ángel; Barriga Barros, Ángel; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Université Catholique de Louvain, 1997)
This communication presents the evidence of a degradation effect causing important reductions in the delay of a CMOS ...
Article
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Analysis of Metastable Operation in a CMOS Dynamic D-Latch

Juan Chico, Jorge; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel; Valencia Barrero, Manuel; Huertas Díaz, José Luis; Huertas Díaz, José Luis (Springer, 1997)
Nowadays, metastability is becoming a serious problem in high-performance VLSI design, mainly due to the relatively-high ...
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Sistema multimedia móvil aplicado a la enseñanza de la electrónica

Fortet Roura, Pedro; Fortet Roura, Pedro; Sivianes Castillo, Francisco; Sivianes Castillo, Francisco; Borja, J.A.; Borja, J.A.; Molina Cantero, Alberto Jesús; Molina Cantero, Alberto Jesús; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (Universidad de Sevilla, 1996)
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New CMOS VLSI Linear Self-Timed Architectures

Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel; Barriga Barros, Ángel; Barriga Barros, Ángel; Jiménez, R.; Jiménez, R.; Huertas Díaz, José Luis; Huertas Díaz, José Luis (1995)
The implementation of digital signal processor circuits via self-timed techniques is currently a valid altemative to solve ...
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Sistemas multimedia de enseñanza aprendizaje de la electrónica

Fortet Roura, Pedro; Fortet Roura, Pedro; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Sivianes Castillo, Francisco; Sivianes Castillo, Francisco; Medina Rodríguez, Ana Verónica; Medina Rodríguez, Ana Verónica (Universitat de Barcelona, 1995)
En un mundo complejo y cambiante como el nuestro, a veces resulta difícil comprender en profundidad los avances que vivimos ...
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Enseñanza integrada: Una aplicación a la docencia de circuitos secuenciales

Parra Fernández, María del Pilar; Parra Fernández, María del Pilar; Baena Oliva, María del Carmen; Baena Oliva, María del Carmen; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Universidad Politécnica de Madrid, 1994)
PhD Thesis
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Biestables CMOS VLSI problemas y aplicaciones

Valencia Barrero, Manuel; Valencia Barrero, Manuel; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús (1994)
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Aplicación del VHDL en prácticas de diseño de sistemas digitales

Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel; Barriga Barros, Ángel; Barriga Barros, Ángel (Universidad Politécnica de Madrid, 1994)
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Modeling of Real Bistables in VHDL

Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Barriga Barros, Ángel; Barriga Barros, Ángel; Valencia Barrero, Manuel; Valencia Barrero, Manuel; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Huertas Díaz, José Luis; Huertas Díaz, José Luis (IEEE Computer Society, 1993)
A complete VHDL model of bistables including their metastable operation is presented. An RS-NAND latch has been modelled ...
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Un nuevo modelo de retraso para puertas lógicas CMOS

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Núñez, R.; Núñez, R.; Barriga Barros, Ángel; Barriga Barros, Ángel; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Universidad de Málaga, 1993)
Los modelos de retraso para puertas lógicas, que usan la mayoría de los simuladores lógicos, carecen de la suficiente ...
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Arquitectura para el diseño de circuitos autotemporizados bidimensionales. Realización de multiplicadores

Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Barriga Barros, Ángel; Barriga Barros, Ángel; Valencia Barrero, Manuel; Valencia Barrero, Manuel (Universidad de Málaga, 1993)
La realización de sistemas digitales mediante técnicas autotemporizadas constituye la mejor alternativa para resolver la ...
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Determinación del coeficiente de resolución en biestables RS CMOS

Bellido Díaz, Manuel Jesús; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Valencia Barrero, Manuel; Acosta Jiménez, Antonio José; Acosta Jiménez, Antonio José; Barriga Barros, Ángel; Barriga Barros, Ángel (Universidad Politécnica de Madrid. Laboratorio de Sistemas Integrados, 1992)
El diseño de biestables con riesgo de metaestabili­dad requiere que posean coeficientes de resolución adecuados. En este ...