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Listar Ponencias (Tecnología Electrónica) por autor "Acosta Jiménez, Antonio José"
Mostrando ítems 1-18 de 18
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Ponencia
A Security Comparison between AES-128 and AES-256 FPGA implementations against DPA attacks
Zúñiga González, Virginia; Tena Sánchez, Erica; Acosta Jiménez, Antonio José (Institute of Electrical and Electronics Engineers, 2023-12)As the AES is the standard symmetric cipher selected by NIST, is the best-known and the most widely used block cipher. ...
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Ponencia
Aplicación del VHDL en prácticas de diseño de sistemas digitales
Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Barriga Barros, Ángel (Universidad Politécnica de Madrid, 1994) -
Ponencia
Arquitectura para el diseño de circuitos autotemporizados bidimensionales. Realización de multiplicadores
Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Barriga Barros, Ángel; Valencia Barrero, Manuel (Universidad de Málaga, 1993)La realización de sistemas digitales mediante técnicas autotemporizadas constituye la mejor alternativa para resolver la ...
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Ponencia
Asymmetric clock driver for improved power and noise performances
Castro, Javier; Parra Fernández, María del Pilar; Valencia Barrero, Manuel; Acosta Jiménez, Antonio José (IEEE Computer Society, 2007)One of the most important sources of switching noise and power consumption in large VLSI circuits is the clock generation ...
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Ponencia
Automated experimental setup for EM cartography to enhance EM attacks
Tena Sánchez, Erica; Casado Galán, Alejandro; Zúñiga González, Virginia; Potestad Ordóñez, Francisco Eugenio; Acosta Jiménez, Antonio José (2022)Side-channel attacks are a real threat, exploiting and revealing the secret data stored in our electronic devices ...
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Ponencia
Concepción de un microprocesador: de la especificación a la realización
Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Acosta Jiménez, Antonio José (Universidad Politécnica de Madrid, 2000) -
Ponencia
Delay degradation effect in submicronic CMOS inverters
Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Barriga Barros, Ángel; Valencia Barrero, Manuel (Université Catholique de Louvain, 1997)This communication presents the evidence of a degradation effect causing important reductions in the delay of a CMOS ...
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Ponencia
Determinación del coeficiente de resolución en biestables RS CMOS
Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Acosta Jiménez, Antonio José; Barriga Barros, Ángel (Universidad Politécnica de Madrid. Laboratorio de Sistemas Integrados, 1992)El diseño de biestables con riesgo de metaestabilidad requiere que posean coeficientes de resolución adecuados. En este ...
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Ponencia
Un entorno informático de ayuda a la docencia de sistemas de comunicación optoelectrónicos
Verd, J.; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José (Universidad Politécnica de Madrid, 2000) -
Ponencia
Experimental cartography generation methodology for Electromagnetic Fault Injection Attacks [póster]
Rincón Beneyto, Juan Carlos; Casado Galán, Alejandro; Potestad Ordóñez, Francisco Eugenio; Acosta Jiménez, Antonio José; Tena Sánchez, Erica (IEEE, 2023-11-17)The Electromagnetic Fault Injection (EMFI) is one of the methods to inject faults in the circuits with different purposes, ...
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Ponencia
Gate-Level Simulation of CMOS Circuits Using the IDDM Model
Bellido Díaz, Manuel Jesús; Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel (IEEE Computer Society, 2001)Timing verification of digital CMOS circuits is a key point in the design process. In this contribution we present the ...
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Ponencia
HALOTIS: high accuracy LOgic TIming simulator with inertial and degradation delay model
Ruiz de Clavijo Vázquez, Paulino; Juan Chico, Jorge; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel (IEEE Computer Society, 2001)This communication presents HALOTIS, a novel high accuracy logic timing simulation tool, that incorporates a new simulation ...
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Ponencia
Hamming-code based fault detection design methodology for block ciphers
Potestad Ordóñez, Francisco Eugenio; Tena Sánchez, Erica; Chaves, Ricardo; Valencia Barrero, Manuel; Acosta Jiménez, Antonio José; Jiménez Fernández, Carlos Jesús (IEEE Computer Society, 2020)Fault injection, in particular Differential Fault Analysis (DFA), has become one of the main methods for exploiting ...
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Ponencia
Inertial and Degradation Delay Model for CMOS Logic Gates
Juan Chico, Jorge; Ruiz de Clavijo Vázquez, Paulino; Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel (IEEE Computer Society, 2000)The authors present the Inertial and Degradation Delay Model (IDDM) for CMOS digital simulation. The model combines the ...
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Ponencia
Modeling of Real Bistables in VHDL
Acosta Jiménez, Antonio José; Barriga Barros, Ángel; Valencia Barrero, Manuel; Bellido Díaz, Manuel Jesús; Huertas Díaz, José Luis (IEEE Computer Society, 1993)A complete VHDL model of bistables including their metastable operation is presented. An RS-NAND latch has been modelled ...
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Ponencia
New CMOS VLSI Linear Self-Timed Architectures
Acosta Jiménez, Antonio José; Bellido Díaz, Manuel Jesús; Valencia Barrero, Manuel; Barriga Barros, Ángel; Jiménez, R.; Huertas Díaz, José Luis (1995)The implementation of digital signal processor circuits via self-timed techniques is currently a valid altemative to ...
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Ponencia
Un nuevo modelo de retraso para puertas lógicas CMOS
Bellido Díaz, Manuel Jesús; Acosta Jiménez, Antonio José; Núñez, R.; Barriga Barros, Ángel; Valencia Barrero, Manuel (Universidad de Málaga, 1993)Los modelos de retraso para puertas lógicas, que usan la mayoría de los simuladores lógicos, carecen de la suficiente ...
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Ponencia
Selective Clock-Gating for Low Power/Low Noise Synchronous Counters
Parra Fernández, María del Pilar; Acosta Jiménez, Antonio José; Valencia Barrero, Manuel (Springer, 2002)The objective of this paper is to explore the applicability of clock gating techniques to binary counters in order to ...