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Ponencia
Realización de un filtro activo de potencia empleando una FPGA
dc.creator | Carrasco Solís, Juan Manuel | es |
dc.creator | Galván Díez, Eduardo | es |
dc.creator | Pérez Ridao, Francisco | es |
dc.creator | Jiménez, R. | es |
dc.creator | Alarcón, D. | es |
dc.creator | Torralba Silgado, Antonio Jesús | es |
dc.creator | Pozo, F. del | es |
dc.creator | García Franquelo, Leopoldo | es |
dc.date.accessioned | 2015-03-13T12:13:43Z | |
dc.date.available | 2015-03-13T12:13:43Z | |
dc.date.issued | 1995 | es |
dc.identifier.uri | http://hdl.handle.net/11441/23478 | |
dc.description.abstract | En este artículo se presenta un sistema para compensación de reactiva y eliminación de armónicos en la conexión de una carga a una red eléctrica. El sistema emplea una simple tarjeta que incorpora una FPGA, un microprocesador, una memoria doble puerta y convertidores A/D, y que genera directamente los pulsos de disparo de los elementos de conmutación de un inversor trifásico. | es |
dc.format | application/pdf | es |
dc.language.iso | spa | es |
dc.relation.ispartof | Design of Circuits and Integrated Systems, 407-411. Zaragoza : DCIS | es |
dc.rights | Attribution-NonCommercial-NoDerivatives 4.0 Internacional | es |
dc.rights.uri | http://creativecommons.org/licenses/by-nc-nd/4.0/ | es |
dc.title | Realización de un filtro activo de potencia empleando una FPGA | es |
dc.type | info:eu-repo/semantics/conferenceObject | es |
dcterms.identifier | https://ror.org/03yxnpp24 | |
dc.rights.accessRights | info:eu-repo/semantics/openAccess | es |
dc.contributor.affiliation | Universidad de Sevilla. Departamento de Ingeniería Electrónica | es |
dc.relation.publisherversion | 10.13140/2.1.4654.1764 | |
dc.identifier.idus | https://idus.us.es/xmlui/handle/11441/23478 |
Ficheros | Tamaño | Formato | Ver | Descripción |
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