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Ponencia

dc.creatorMora Gutiérrez, José Migueles
dc.creatorSassaw Teshome, G.es
dc.creatorJiménez Fernández, Carlos Jesúses
dc.creatorValencia Barrero, Manueles
dc.date.accessioned2018-07-17T08:33:20Z
dc.date.available2018-07-17T08:33:20Z
dc.date.issued2010
dc.identifier.citationMora Gutiérrez, J.M., Sassaw Teshome, G., Jiménez Fernández, C.J. y Valencia Barrero, M. (2010). Metodologia orientada a la elección de FPGAs con prioridad en el consumo de potencia. En XVI Workshop Iberchip, Iguazú (Brasil) del 23 al 25 de febrero de 2010.
dc.identifier.urihttps://hdl.handle.net/11441/77333
dc.description.abstractEn este trabajo se presenta una metodología de diseño orientada a explorar el cada vez más amplio conjunto de FPGAs con el fin de seleccionar la mejor opción. Los parámetros que se utilizan para realizar la exploración son los recursos consumidos, la frecuencia de operación y el consumo de potencia. Sobre este último parámetro, el más difícil de medir, se hace un especial énfasis. Se exploran dos fabricantes (Altera y Xilinx), dos familias diferentes de cada fabricante y dos subfamilias dentro de cada familia, una de la gama alta y otra de la gama baja. Esta exploración se ha realizado implementando dos circuitos que realizan la operación división de números de 64 bits usando dos algoritmos con plena vigencia.es
dc.description.sponsorshipEspaña, Ministerio de Educación y Ciencia TEC2007-65105/MICes
dc.description.sponsorshipEspaña, Junta de Andalucía TIC-3604es
dc.formatapplication/pdfes
dc.language.isospaes
dc.relation.ispartofXVI Workshop Iberchip (2010), p 1-4
dc.rightsAttribution-NonCommercial-NoDerivatives 4.0 Internacional*
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/4.0/*
dc.subjectDivisor NonRestores
dc.subjectSRTes
dc.subjectFPGAes
dc.titleMetodologia orientada a la elección de FPGAs con prioridad en el consumo de potenciaes
dc.typeinfo:eu-repo/semantics/conferenceObjectes
dcterms.identifierhttps://ror.org/03yxnpp24
dc.type.versioninfo:eu-repo/semantics/acceptedVersiones
dc.rights.accessRightsinfo:eu-repo/semantics/openAccesses
dc.contributor.affiliationUniversidad de Sevilla. Departamento de Tecnología Electrónicaes
dc.relation.projectIDTEC2007-65105/MICes
dc.relation.projectIDTIC-3604es
dc.relation.publisherversionhttp://www.inf.ufrgs.br/iberchip/registration.phpes
idus.format.extent4 p.es
dc.publication.initialPage1es
dc.publication.endPage4es
dc.eventtitleXVI Workshop Iberchipes
dc.eventinstitutionIguazú (Brasil) del 23 al 25 de febrero de 2010es
dc.contributor.funderMinisterio de Educación y Ciencia (MEC). España
dc.contributor.funderJunta de Andalucía

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