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Trabajo Fin de Máster

dc.contributor.advisorLeger Leger, Gildases
dc.creatorGutiérrez Gil, Valentínes
dc.date.accessioned2018-11-06T12:49:09Z
dc.date.available2018-11-06T12:49:09Z
dc.date.issued2018-09
dc.identifier.urihttps://hdl.handle.net/11441/79831
dc.formatapplication/pdfes
dc.language.isoenges
dc.rightsAttribution-NonCommercial-NoDerivatives 4.0 Internacional*
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/4.0/*
dc.titleOptimización del flujo de simulación de defectos y fallos en circuitos analógicos y de señal mixtaes
dc.title.alternativeOptimization of the defect and fault simulation flow in analog and mixed signal circuitses
dc.typeinfo:eu-repo/semantics/masterThesises
dc.type.versioninfo:eu-repo/semantics/publishedVersiones
dc.rights.accessRightsinfo:eu-repo/semantics/openAccesses
dc.contributor.affiliationUniversidad de Sevilla. Departamento de Electrónica y Electromagnetismoes
dc.description.degreeUniversidad de Sevilla. Máster Universitario en Microelectrónica: Diseño y Aplicaciones de Sistemas Micro/Nanométricoses
idus.format.extent79 p.es

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