Perfil del autor: Valencia Barrero, Manuel
Datos institucionales
| Nombre | Valencia Barrero, Manuel |
| Departamento | Tecnología Electrónica |
| Área de conocimiento | Tecnología Electrónica |
| Categoría profesional | Catedrático de Universidad |
| Correo electrónico | Solicitar |
 |
|
Estadísticas
-
Nº publicaciones
77
-
Nº visitas
8018
-
Nº descargas
16376
| Publicaciones |
|---|
Capítulo de Libro
 Design and security evaluation of secure cryptoharware (FPGA and ASIC) against hackers exploiting side-channel information
(3ciencias, 2022)
Tradicionalmente, la seguridad en los dispositivos criptográficos estaba ligada exclusivamente a la fortaleza del algoritmo. ... |
Capítulo de Libro
Metodología de diseño para la detección de fallos en cifradores de bloques basada en códigos de Hamming
(3ciencias, 2022)
La inserción de fallos y en concreto los análisis diferenciales de fallos (Differential Fault Analysis – DFA) se han ... |
Artículo
Trivium Stream Cipher Countermeasures Against Fault Injection Attacks and DFA
(Institute of Electrical and Electronics Engineers. IEEE, 2021)
Attacks on cryptocircuits are becoming increasingly sophisticated, requiring designers to include more and more countermeasures ... |
Artículo
Experimental FIA Methodology Using Clock and Control Signal Modifications under Power Supply and Temperature Variations
(MDPI, 2021)
The security of cryptocircuits is determined not only for their mathematical formulation, but for their physical implementation. ... |
Artículo
 Breaking Trivium Stream Cipher Implemented in ASIC Using Experimental Attacks and DFA
(MDPI, 2020)
One of the best methods to improve the security of cryptographic systems used to exchange sensitive information is to ... |
Artículo
ASIC Design and Power Characterization of Standard and Low Power Multi-Radix Trivium
(IEEE Computer Society, 2020)
We are presenting the experimental measurements of the power consumption and the maximum frequency in an ASIC prototype ... |
Ponencia
Learning VHDL through teamwork FPGA game design
(IEEE Computer Society, 2020)
The learning of digital design at the RT level by the students improves with practical work, which can be developed in ... |
Artículo
An Academic Approach to FPGA Design Based on a Distance Meter Circuit
(IEEE Computer Society, 2020)
Digital design learning at Register Transfer (RT) level requires practical and complex examples as learning progresses. ... |
Ponencia
Hamming-code based fault detection design methodology for block ciphers
(IEEE Computer Society, 2020)
Fault injection, in particular Differential Fault Analysis (DFA), has become one of the main methods for exploiting ... |
Ponencia
Desarrollo de un juego sobre FPGA mediante trabajo en equipo
(Asociación Tecnología, Aprendizaje y Enseñanza de la Electrónica (TAEE), 2020)
El aprendizaje de diseño digital a nivel RT por los alumnos mejora con trabajos prácticos, desarrollables en equipo, que ... |
Tesis Doctoral
 Vulnerabilidad y análisis diferencial mediante inserción de fallos de cifradores Trivium en FPGA y ASIC.
(2019)
Las comunicaciones entre dispositivos aumenta día a día y un gran ejemplo de ello es el crecimiento del Internet de las ... |
Ponencia
Ejemplo de diseño FPGA para medidas de máximas frecuencias de operación
(Universidad de La Laguna, 2018)
La mejor forma de aprender a diseñar sistemas digitales a nivel RT es haciendo uso de ejemplos prácticos. Además, desde ... |
Ponencia
Medición de distancias como ejemplo práctico de diseño en FPGAs
(Universidad de La Laguna, 2018)
El aprendizaje de diseño digital a nivel RT requiere de ejemplos prácticos y conforme se avanza en el aprendizaje se precisa ... |
Trabajo Fin de Grado
Procesado de señales de audio mediante FPGAs
(2018)
En este proyecto se ha implementado un sistema de procesado de señales de audio en una FPGA, con el fin de crear diferentes ... |
Ponencia
FPGA design example for maximum operating frequency measurements
(IEEE Computer Society, 2018)
The best way to learn how to design digital systems at the RT level is to use practical examples. In addition, from ... |
Ponencia
Floorplanning as a practical countermeasure against clock fault attack in Trivium stream cipher
(IEEE Computer Society, 2018)
The fault injection in ciphers operation is a very successful mechanism to attack them. The inclusion of elements of ... |
Trabajo Fin de Grado
Sistema para ataques a cifradores Triviums implementados en FPGAs
(2018)
La información intercambiada diariamente en las redes de comunicación crece de forma exponencial y gran parte de ella está ... |
Ponencia
Distance measurement as a practical example of FPGA design
(IEEE Computer Society, 2018)
Digital design learning at the RT level requires practical examples and as learning progresses, the examples need to become ... |
Tesis Doctoral
Implementaciones VLSI de cifradores de flujo Trivium de bajo consumo
(2017)
En toda comunicación de datos se hace necesario proteger y garantizar de una manera adecuada la información enviada a ... |
Artículo
Trivium hardware implementations for power reduction
(Wiley, 2017)
This paper describes the use of parallelization techniques to reduce dynamic power consumption in hardware implementations ... |
Artículo
Vulnerability Analysis of Trivium FPGA Implementations
(IEEE Computer Society, 2017)
Today, the large amount of information exchanged among various devices as well as the growth of the Internet of Things ... |
Artículo
Multiradix Trivium Implementations for Low-Power IoT Hardware
(IEEE Computer Society, 2017)
The integration of lightweight symmetric encryption is becoming increasingly widespread in very low-power Internet of ... |
Ponencia
Fault Attack on FPGA implementations of Trivium Stream Cipher
(IEEE Computer Society, 2016)
This article presents the development of an experimental system to introduce faults in Trivium stream ciphers implemented ... |
Ponencia
Creación de carteles autoexplicativos para laboratorios de electrónica
(Universidad de Sevilla, 2016)
Se presenta un proyecto cuyo objetivo ha sido ha sido la creación de carteles que, a modo de tutoriales resumidos, muestran ... |
Ponencia
Fault Injection on FPGA implementations of Trivium Stream Cipher using Clock Attacks
(Universitat Politécnica de Catalunya, 2016)
|
Ponencia
Creating helping posters for electronic labs
(IEEE Computer Society, 2016)
A Project is presented whose aim was to develop a set of posters that, as small tutorials, shows in a very visual way what ... |
Ponencia
Educational applications of a pico-processor design
(IEEE Computer Society, 2016)
Knowledge of the internal structure and operating mechanism of microprocessors is a very important part in for engineers ... |
Ponencia
Diseño de circuitos integrados y seguridad de circuitos criptográficos frente a ataques
(Área de Innovación y Desarrollo, 2016)
Muchos sistemas electrónicos incorporan dispositivos criptográficos que implementan algoritmos que cifran la información ... |
Ponencia
Experimental and Timing Analysis Comparison of FPGA Trivium Implementations and their Vulnerability to Clock Fault Injection
(IEEE Computer Society, 2016)
The security of cryptocircuits is today threatened not only by attacks on algorithms but also, and above all, by attacks ... |
Ponencia
Aplicaciones docentes del diseño de un pico-procesador
(Universidad de Sevilla, 2016)
El conocimiento de la estructura interna y del mecanismo de funcionamiento de microprocesadores es una parte muy importante ... |
Capítulo de Libro
Sistema de transmisión de mensajes con cifrado lightweight como proyecto en asignatura de Máster
(Universidad de Deusto, 2014)
Las asignaturas de Máster deben ser muy prácticas, aplicando los conocimientos a problemas concretos. En este trabajo se ... |
Ponencia
A message transmission system with lightweight encryption as a project in a Master subject
(IEEE Computer Society, 2014)
Master subjects should ideally be very practical, to allow students to apply the knowledge they have acquired to the solving ... |
| Tesis Doctoral |
Ponencia
Low Power Implementation of Trivium Stream Cipher
(Springer, 2012)
This paper describes a low power hardware implementation of the Trivium stream cipher based on shift register parallelization ... |
Ponencia
High Radix Implementation of Montgomery Multipliers with CSA
(IEEE Computer Society, 2010)
Modular multiplication is the key operation in systems based on public key encryption, both for RSA and elliptic curve ... |
Ponencia
Montaje de un amplificador de audio en las prácticas de electrónica analógica
(2010)
En esta comunicación se presenta el rediseño de las prácticas de laboratorio de la asignatura Electrónica Analógica con ... |
Ponencia
Innovative learning and teaching methodology in electronic technology area: A case of study in computer science university degrees
(IEEE Computer Society, 2010)
This paper describes an experience that has been carried out by several professors in different subjects. Our experience ... |
Ponencia
Metodologia orientada a la elección de FPGAs con prioridad en el consumo de potencia
(2010)
En este trabajo se presenta una metodología de diseño orientada a explorar el cada vez más amplio conjunto de FPGAs con ... |
Artículo
Estudio comparativo de los divisores en la tecnologías CMOS nanométricas
(Instituto Superior Politécnico José Antonio Echeverría (CUJAE), 2009)
Son varios los algoritmos de divisores propuestos para su realización en hardware, sin que haya un ‘mejor divisor’. La ... |
Ponencia
Estudio Cuantitativo de 10 Años de Calificaciones
(Universidad Politécnica de Madrid, 2008)
En este trabajo se presenta un estudio cuantitativo sobre todas las notas de las actas de cuatro asignaturas troncales ... |
Ponencia
Presencia y Abandono de Alumnos en Nuestras Asignaturas
(Universidad Politécnica de Madrid, 2008)
En este trabajo se presenta un análisis cuantitativo sobre el seguimiento real de las actividades académicas por parte ... |
Ponencia
Asymmetric clock driver for improved power and noise performances
(IEEE Computer Society, 2007)
One of the most important sources of switching noise and power consumption in large VLSI circuits is the clock generation ... |
Ponencia
Introducción de dispositivos programables en prácticas de laboratorio
(Universidad Politécnica de Madrid, 2006)
En esta comunicación se presenta la realización de una práctica de la asignatura Estructura de Computadores de primer curso ... |
Ponencia
Formación de profesores noveles en tecnología electrónica: una primera aproximación
(Universidad de Sevilla, Instituto de Ciencias de la Educación, 2005)
Los profesores universitarios de áreas científicas y técnicas están cada vez más preocupados por desarrollar adecuadamente ... |
Ponencia
Realización de prácticas de electrónica digital con un esquema de documentación jerarquizada
(Universidad Politécnica de Valencia, 2004)
En esta comunicación se presenta la realización de una actividad teórico-práctica, encuadrada dentro del marco ECTS, para ... |
Capítulo de Libro
Measurement of the Switching Activity of CMOS Digital Circuits at the Gate Level
(Springer, 2002)
Accurate estimation of switching activity is very important in digital circuits. In this paper we present a comparison ... |
Ponencia
Organización de un computador específico para bases de datos (CBD)
(Universidad Politécnica de Madrid, 2002)
Se presenta un computador diseñado para optimizar las aplicaciones de base de datos. Para ello se han generado un conjunto ... |
Ponencia
Diseño y simulación de CBD con ALLIANCE
(Universidad Politécnica de Madrid, 2002)
Se presenta el diseño y simulación del procesador específico para bases de datos (CBD) usando un entorno de diseño de libre ... |
Ponencia
Selective Clock-Gating for Low Power/Low Noise Synchronous Counters
(Springer, 2002)
The objective of this paper is to explore the applicability of clock gating techniques to binary counters in order to ... |
Ponencia
AUTODDM: AUTOmatic characterization tool for the Delay Degradation Model
(IEEE Computer Society, 2001)
As delay models used in logic timing simulation become more and more complex, the problem of model parameter values ... |
Ponencia
Gate-Level Simulation of CMOS Circuits Using the IDDM Model
(IEEE Computer Society, 2001)
Timing verification of digital CMOS circuits is a key point in the design process. In this contribution we present the ... |
Ponencia
HALOTIS: high accuracy LOgic TIming simulator with inertial and degradation delay model
(IEEE Computer Society, 2001)
This communication presents HALOTIS, a novel high accuracy logic timing simulation tool, that incorporates a new simulation ... |
Tesis Doctoral
Degradación del retraso de propagación en puertas lógicas CMOS VLSI
(2000)
La evolución en la tecnología de circuitos VLSI da lugar, entre otras cosas, a un aumento en la escala de integración ... |
Ponencia
EMU68
(Universidad Politécnica de Madrid, 2000)
|
Ponencia
Inertial and Degradation Delay Model for CMOS Logic Gates
(IEEE Computer Society, 2000)
The authors present the Inertial and Degradation Delay Model (IDDM) for CMOS digital simulation. The model combines the ... |
Ponencia
Emulador de un procesador sencillo
(Universidad Politécnica de Madrid, 2000)
|
Capítulo de Libro
Degradation Delay Model Extension to CMOS Gates
(Springer, 2000)
This contribution extends the Degradation Delay Model (DDM), previously developed for CMOS inverters, to simple logic ... |
Ponencia
Diseño de un procesador sencillo con carácter docente: teoría y práctica
(Universidad Politécnica de Madrid, 2000)
|
Capítulo de Libro
Influence of Clocking Strategies on the Design of Low Switching-Noise Digital and Mixed-Signal VLSI Circuits
(Springer, 2000)
This communication shows the influence of clocking schemes on the digital switching noise generation. It will be shown how ... |
Ponencia
Realización de un Sistema Digital: implementación sobre FPGA y testado en Laboratorio
(Universidad Politécnica de Madrid, 1998)
|
Ponencia
Sistema Multimedia Aplicado a la enseñanza de semiconductores
(Universidad Politécnica de Madrid, 1998)
|
Ponencia
Delay degradation effect in submicronic CMOS inverters
(Université Catholique de Louvain, 1997)
This communication presents the evidence of a degradation effect causing important reductions in the delay of a CMOS ... |
Artículo
Analysis of Metastable Operation in a CMOS Dynamic D-Latch
(Springer, 1997)
Nowadays, metastability is becoming a serious problem in high-performance VLSI design, mainly due to the relatively-high ... |
| Artículo |
Ponencia
New CMOS VLSI Linear Self-Timed Architectures
(1995)
The implementation of digital signal processor circuits via self-timed techniques is currently a valid altemative to solve ... |
Ponencia
Enseñanza integrada: Una aplicación a la docencia de circuitos secuenciales
(Universidad Politécnica de Madrid, 1994)
|
Ponencia
CADPC: Un entorno de diseño de circuitos digitales en ordenadores personales
(Universidad Politécnica de Madrid, 1994)
|
Ponencia
Aplicación del VHDL en prácticas de diseño de sistemas digitales
(Universidad Politécnica de Madrid, 1994)
|
| Tesis Doctoral |
| Tesis Doctoral |
Ponencia
Modeling of Real Bistables in VHDL
(IEEE Computer Society, 1993)
A complete VHDL model of bistables including their metastable operation is presented. An RS-NAND latch has been modelled ... |
Ponencia
Arquitectura para el diseño de circuitos autotemporizados bidimensionales. Realización de multiplicadores
(Universidad de Málaga, 1993)
La realización de sistemas digitales mediante técnicas autotemporizadas constituye la mejor alternativa para resolver la ... |
Ponencia
Un nuevo modelo de retraso para puertas lógicas CMOS
(Universidad de Málaga, 1993)
Los modelos de retraso para puertas lógicas, que usan la mayoría de los simuladores lógicos, carecen de la suficiente ... |
Ponencia
Determinación del coeficiente de resolución en biestables RS CMOS
(Universidad Politécnica de Madrid. Laboratorio de Sistemas Integrados, 1992)
El diseño de biestables con riesgo de metaestabilidad requiere que posean coeficientes de resolución adecuados. En este ... |
Ponencia
Redes e interconexiones de procesadores con capacidad de tolerancia a fallos
(Universidad Politécnica de Madrid, 1992)
Se describe una familia de redes de interconexión para sistemas multiprocesadores. Estas redes utilizan buses múltiples ... |
Tesis Doctoral
Modelado discreto descripción lógica y simulación de fenómenos inestables en circuitos secuenciales
(1986)
En la última década hemos asistido a la penetración de los sistemas digitales en la vida cotidiana. Por citar sólo un ... |
Artículo
Asynchronous Modular Arbiter
(IEEE Computer Society, 1986)
A practical N-user arbiter and its implementation are presented in this correspondence. Because of the asynchronous character ... |